LDO是一種微功耗的低壓差線性穩壓器，它具有極低的自有噪聲和較高的電源抑制比(PSRR)。SGM2007高性能低壓差線性穩壓器在10Hz至100kHz頻率范圍內的輸出噪聲為30 μV(RMS)，在 1 kHz 的頻率下電源抑制比(PSRR)高達73dB，它能夠為諸如射頻（RF）接收器和發送器、壓控振蕩器（VCO）和音頻放大器等對噪聲敏感的模擬電路的供電提供低噪聲、電源紋波抑制比（PSRR）和快速瞬態響應，它的使能電路兼容TTL電平適合數字電路供電。SGM2007的輸入電壓在2.5V至5.5V之間，適合藍牙數碼相機和個人數字助理（PDA），以及諸如無線和高端音頻產品等單個鋰電池供電或固定3.3V和5V系統。

LDO的低壓差線性穩壓器的結構主要包括啟動電路、恒流源偏置單元、使能電路、調整元件、基準源、誤差放大器、反饋電阻網絡，保護電路等，基本工作原理是這樣的：系統加電，如果使能腳處于高電平時，電路開始啟動，恒流源電路給整個電路提供偏置，基準源電壓快速建立，輸出隨著輸入不斷上升，當輸出即將達到規定值時，由反饋網絡得到的輸出反饋電壓也接近于基準電壓值，此時誤差放大器將輸出反饋電壓和基準電壓之間的誤差小信號進行放大，再經調整管放大到輸出，從而形成負反饋，保證了輸出電壓穩定在規定值上；同理如果輸入電壓變化或輸出電流變化，這個閉環回路將使輸出電壓保持不變，即：

Vout=（R1+R2）/R2 * Vref

POWER supply ripple rejection ratio (PSRR)是反應LDO輸出對輸入紋波抑制的一個交流參數，輸出和輸入的頻率是一樣的。和噪聲（Nosie）不同，噪聲一般為在10Hz至100kHz頻率范圍內一定輸入電壓下其輸出噪聲電壓的均方值,PSRR的單位是dB。

PSRR=20 log（△vin/△vout）

大多數蜂窩電話基帶芯片組需要三組電源：內部數字電路、模擬電路和外設接口電路。基帶處理器（BB）的數字電路供電電壓的典型值為1.8V至2.6V，一般情況下，Li+電池電壓降至3.2V-3.3V時電話將被關閉，對于為基帶處理器供電的LDO來說至少有500至600mV的壓差，因此對壓差要求不高。另外，數字電路本身對LDO的輸出噪聲和PSRR的要求也不高，而是要求LDO在輕載條件下具有極低的靜態電流。

基帶處理器內部模擬電路供電電壓典型值是2.4V至3.0V，壓差在200mV至600mV。要求LDO具有較高的低頻（GSM電話為217Hz）紋波抑制能力，消除由RF功率放大器產生的電池電壓紋波。LDO始終保持有效工作狀態，同樣需要較低的靜態電流指標。

RF電路分為接收和發送兩部分，供電電壓典型值為2.6V至3.0V，其中低噪聲放大器（LNA）、混頻器、鎖相環（PLL）、壓控振蕩器（VCO）和中頻（IF）電路需要低噪聲、高PSRR的LDO。實際應用中，VCO、PLL電路的性能直接影響射頻電路指標，如發射頻譜的純度、接收器的選擇性、模擬收發器的噪聲、數字電路的相位誤差等。噪聲會改變振蕩器的相頻和幅頻特性，同時振蕩器環路也會進一步放大噪聲，可能對載波產生調制。LDO輸出噪聲受其內部設計和外部旁路、補償電路的影響。如圖是線性穩壓器的簡單框圖。導致LDO輸出噪聲的主要來源是基準。

為降低基準噪聲，用于連接基準旁路電容。增大旁路電容能夠使基準噪聲成為產生LDO輸出噪聲的次要因素，有利于減小輸出噪聲。建議使用陶瓷電容的典型值為 470 pF 到 0.01 μF 。也可使用此范圍以外的電容，但會對輸入電源上電時LDO 輸出電壓上升的速度產生影響，旁路電容值越大，輸出電壓上升速率越慢。在使用時這點要注意。

影響LDO輸出噪聲的其它因素還有：LDO內部極點、零點和輸出極點。增大輸出電容的容量或減輕輸出負載有利于降低高頻輸出噪聲。如圖為旁路電容對SG2001輸出噪聲影響。

LDO需要增加外部輸入和輸出電容器。利用較低ESR的大電容器一般可以全面提高電源抑制比(PSRR)、噪聲以及瞬態性能。 陶瓷電容器通常是首選，因為它們價格低而且故障模式是斷路，相比之下鉭電容器比較昂貴且其故障模式是短路。輸出電容器的等效串聯電阻(ESR)會影響其穩定性，陶瓷電容器具有較低的ESR，大概為10 mΩ量級 采用陶瓷電容時，建議使用X5R 和X7R電介質材料，這是因為它們具有較好的溫度穩定性。圖為X5R的ESR和頻率曲線。